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제목 KAIST 최양규 교수 언론보도 (뉴스1 2015.11.23 기사) 등록일 2015.11.25
참조 1 : http://news1.kr/articles/?2495484
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5배 성능 향상된 반도체 트랜지스터 개발


KAIST 이변현. 강민호 연구팀…제작 시간 단축 등 기대
(대전=뉴스1) 박영문 기자 | 2015-11-23 11:37:31 송고


기존보다 5배가량 성능이 향상된 반도체 트랜지스터가 국내 연구진에 의해 개발돼 지속적 소형화로 인한 기술적 한계 극복에 도움이 될 것으로 기대되고 있다.

한국과학기술원(KAIST)는 23일 전기 및 전자공학부 이병현 연구원과 나노종합기술원 강민호 박사가 실리콘 기반의 5단 수직 적층 반도체 트랜지스터와 이를 이용한 비휘발성 메모리 개발에 성공했다고 밝혔다.

연구팀은 전면-게이트 실리콘 나노선을 수직 5단으로 쌓아 문제를 해결했다. 개발된 반도체 트랜지스터는 단일 나노선 기반의 트랜지스터보다 5배의 향상된 성능을 보였다.

또 수직 적층 나노선 구조는 단일 구조와 달리 면적이 증가되지 않아 집적도 향상에도 기여할 것으로 연구진은 보고 있다.

특히 나노선 수직 적층은 개발된 '일괄 플라즈마 건식 식각 공정' 방식의 연속 작용을 통해 확보한 결과물이란 분석이다.

이 공정은 고분자 중합체를 이용, 패턴이 형성될 영역에 미리 보호막을 친 뒤 등방성 건식 식각을 통해 나노선 구조를 형성하는 기술이다.

연구팀은 "건식 식각 공정 기술이 기존 방법보다 간단하고 안정적으로 수직 적층 실리콘나노선 구조 제작을 가능하게 함으로써 고성능 트랜지스터 개발에 응용 가능할 것"이라고 밝혔다.

또 "관련 연구가 이전부터 진행됐지만 더 간단한 공정기술을 이용, 가장 많은 나노선 채널의 적층에 성공했다"며 "앞으로 비용절감 및 제작 시간 단축 등에 크게 기여할 것으로 예상된다"고 말했다.

이번 연구는 글로벌프론티어사업 스마트IT융합시스템 연구단의 지원을 받아 수행됐으며 연구결과는 나노 분야 학술지 ‘나노 레터스(Nano letters)’ 11월6일자 온라인 판에 게재됐다.


박영문 기자(etouch84@news1.kr)


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